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[实用新型]一种八输出降频器电路-CN201822048011.3有效
发明人：叶远龙 -专利权人：珠海市普斯赛特科技有限公司
申请日： 2018-12-07 - 公布日： 2019-09-20 - 主分类号： H04N5/44 文献下载
摘要：本实用新型公开一种八输出降频器电路，包括信号源模块、水平信号放大模块、垂直信号放大模块、第一混频模块和第二混频模块，第一、第二混频模块分别包括第一、第二锁相环芯片，水平信号放大模块分别与第一锁相环芯片和第二锁相环芯片连接，垂直信号放大模块分别与第一锁相环芯片和第二锁相环芯片连接，第一锁相环芯片和第二锁相环芯片分别连接有四个信号输出端，第一锁相环芯片和第二锁相环芯片分别对应连接有第一供电模块和第二供电模块，第一锁相环芯片和第二锁相环芯片分别与时钟模块连接本实用新型采用锁相环芯片进行倍频、鉴相、滤波和运算处理，代替传统使用介质震荡的方式，可以解决降频器频率不稳定以及高低温环境中频率变化大的问题。
锁相环芯片放大模块混频模块降频器本实用新型垂直信号水平信号电路第二供电模块第一供电模块高低温环境信号输出端信号源模块传统使用时钟模块输出和运算中频率倍频鉴相滤波震荡

[实用新型]一种高压无功补偿装置的锁相环双冗余切换电路结构-CN202021743774.0有效
发明人：王立春;张雷;李国清;高大为;安万洙;王兴;王光磊;徐维东 -专利权人：辽宁荣信兴业电力技术有限公司
申请日： 2020-08-20 - 公布日： 2021-04-20 - 主分类号： H02J3/18 文献下载
摘要：一种高压无功补偿装置的锁相环双冗余切换电路结构，包括第一锁相环芯片、第二锁相环芯片和双冗余切换电路；第一锁相环芯片为FPGA芯片，第二锁相环芯片为DSP芯片。双冗余切换电路包括依次连接的与门、非门、或门和多路复用开关；第一锁相使能信号和第二锁相使能信号连接多路复用开关的两个使能端，多路复用开关的两个数据输入端分别连接第一锁相环芯片的锁相信号输出端和第二锁相环芯片的锁相信号输出端，两个数据输出端共同输出最终的锁相信号。在现有的锁相环技术的基础上对其电路结构进行改进，同时使用两种锁相芯片，用合理设计的冗余切换电路来实现两种芯片的信号切换，能够发挥两种芯片各自的优点，保证高压无功补偿装置的稳定运行。
一种高压无功补偿装置锁相环双冗余切换电路结构

[发明专利]一种检测锁相环假锁的方法-CN200710074684.X有效
发明人：吴安军 -专利权人：中兴通讯股份有限公司
申请日： 2007-06-01 - 公布日： 2008-03-12 - 主分类号： G01R31/00 文献下载
摘要：本发明公开了一种检测锁相环假锁的方法，包括以下步骤：a.初始化锁相环芯片用到的I/O管脚；b.给锁相环寄存器配置失锁的数据，使得锁相环处于失锁状态；c.检查锁相环是否处于失锁状态，如果失锁，则表明锁相环正常；如果不失锁，则表明锁相环有故障。采用本发明，可以及时有效地检测出有假锁现象的锁相环芯片，预防假锁导致的故障，提高了系统的稳定性。
一种检测锁相环假锁方法

[发明专利]一种基于集成锁相环芯片的快速频率切换微系统-CN201711392874.6有效
发明人：刘晓东;聂利鹏;刘志哲;曹玉雄;陈磊;杜景超 -专利权人：北京遥感设备研究所
申请日： 2017-12-21 - 公布日： 2021-04-09 - 主分类号： H03L7/18 文献下载
摘要：本发明公开了一种基于集成锁相环芯片的快速频率切换微系统，包括：Flash芯片、内置VCO的集成锁相环频率合成器芯片；其中，内置VCO的集成锁相环频率合成器芯片包括倍频/分频器、鉴频鉴相器、电荷泵、环路滤波器集成锁相环芯片与Flash芯片通过SiP方式共同构成基于集成锁相环芯片的快速频率切换微系统。该微系统由内置VCO的集成锁相环频率合成器芯片提供高性能射频频率源信号，并通过对Flash芯片内存储的控制信号的读取，实现对锁相环输出频率的快速切换。
一种基于集成锁相环芯片快速频率切换系统

[发明专利]一种RFID读写器电路-CN200910199526.6无效
发明人：岳流锋 -专利权人：上海坤锐电子科技有限公司
申请日： 2009-11-27 - 公布日： 2011-06-01 - 主分类号： G06K7/00 文献下载
摘要：一种RFID读写器电路，包括微控制单元和RFID读写器芯片，所述微控制单元输出端和所述读写器芯片输入端相连，该读写器芯片具有外部压控振荡器射频输入接口。该读写器电路还包括外部锁相环，该外部锁相环包含内部压控振荡器和射频输出口，该外部锁相环的射频输出口和所述读写器芯片的射频输入端相连。本发明使用外部锁相环代替压控振荡器，价格低廉，且专业的锁相环制造公司制造的锁相环芯片性能非常好，如Si4133，测试表明读卡距离较使用外部压控振荡器还要远约30％。通过合理的布线布局可以使锁相环不受其他电路影响。
一种 rfid 读写电路

[实用新型]一种非整数倍倍频锁相电路-CN201921101710.8有效
发明人：邹润德 -专利权人：青岛瑞普电气股份有限公司
申请日： 2019-07-15 - 公布日： 2020-02-28 - 主分类号： H03L7/18 文献下载
摘要：本实用新型提供一种非整数倍倍频锁相电路，包括信号输入、锁相环和复杂可编程逻辑芯片CPLD，复杂可编程逻辑芯片CPLD对信号输入执行比较操作用以输出比较信号，比较信号连接锁相环，经锁相环实现信号输出；信号输入由锁相环倍频锁相，然后发送给复杂可编程逻辑芯片CPLD作为计数时钟，复杂可编程逻辑芯片CPLD根据计数时钟进行倍频和分频，将分频处理后的计数时钟发送给锁相环作为输入比较信号，和信号输入进行比较，并通过内部的压控振荡器VCO本电路采用锁相环和CPLD芯片的组合电路，由CPLD芯片将锁相环输出的时钟先倍频，然后再分频，实现信号的非整数倍倍频锁相。
一种整数倍频电路

[发明专利]快速锁定的频率源-CN202210032652.8在审
发明人：涂振斌;雷鸥;马军伟;陈晓玉;杨晶晶 -专利权人：上海航天电子通讯设备研究所
申请日： 2022-01-12 - 公布日： 2022-04-22 - 主分类号： H03L7/10 文献下载
摘要：本发明提供了一种快速锁定的频率源，包括低压差线性稳压器芯片、锁相环芯片、捕获电路、滤波器、ARM芯片、射频放大器以及封装件；所述锁相环芯片，用于产生预设频率的射频信号，并将所述射频信号输出至环路滤波器；所述捕获电路，用于输出预置的三角波电压，使锁相环芯片输出的射频信号在锁相环电路的快捕带内，帮助锁相环电路快速锁定；所述环路滤波器，用于滤除所述射频信号中的高次谐波；所述射频放大器，用于实现对所述的射频信号进行放大并输出；所述低压差线性稳压器芯片，用于向所述锁相环芯片、所述捕获电路和所述ARM芯片提供电能；所述ARM芯片，用于提供锁相环芯片初始化程序，锁定预置的频率。
快速锁定频率

[实用新型]一种新型锁相环频率合成器-CN201520807602.8有效
发明人：赵益波;史云姣;阮玮琪 -专利权人：南京信息工程大学
申请日： 2015-10-19 - 公布日： 2016-02-03 - 主分类号： H03L7/18 文献下载
摘要：本实用新型公开了一种新型锁相环频率合成器，包括：参考信号生成模块，用于产生参考信号，具体包括振荡电路与振荡电路连接的参考分频器；锁相环模块，与所述参考信号输入模块连接，用于通过对参考信号和可变分频模块输出信号的相位进行比较，使锁相环模块输出信号与参考信号实现同步，具体包括锁相环集成电路芯片、设置于所述锁相环集成电路芯片外围的环路滤波器和设置于所述锁相环集成电路芯片外围的VCO外部电路；可变分频模块，与所述锁相环模块连接，用于根据锁相环模块输出信号产生分频频率，反馈至锁相环模块，具体以级联的个位分频器和十位分频器为核心。
一种新型锁相环频率合成器

[实用新型]高性能低相噪的宽带小数N分频锁相环本振电路-CN201920056154.0有效
发明人：周仁平;朱立霞;黄明 -专利权人：湖北迈可威通信技术有限公司
申请日： 2019-01-14 - 公布日： 2019-10-25 - 主分类号： H03L7/18 文献下载
摘要：高性能低相噪的宽带小数N分频锁相环本振电路，它涉及本振电路技术领域。应用于无线通信的高性能低相噪的宽带小数N分频锁相环本振电路它包含振荡器、锁相环芯片、电源芯片、第一放大器、第二放大器、滤波器，振荡器和锁相环芯片电性连接，电源芯片设置在锁相环芯片右侧，且电源芯片和锁相环芯片电性连接，锁相环芯片和第一放大器电性连接，第一放大器的右侧设置第二放大器，且第一放大器和第二放大器电性连接，第二放大器和滤波器电性连接。
放大器锁相环芯片电性连接锁相环本振电路电源芯片小数分频宽带滤波器振荡器本实用新型本振电路输出功率无线通信杂散带宽应用

[实用新型]微波雷达系统可变时钟源-CN200420111787.0无效
发明人：文必洋;马志刚;沈伟;严卫东;王才军 -专利权人：武汉大学
申请日： 2004-12-02 - 公布日： 2006-03-01 - 主分类号： G01S7/28 文献下载
摘要：微波雷达系统可变时钟源，它包括分频器与压控振荡器构成的锁相环，锁相环的参考时钟和环路滤波器，锁相环、参考时钟和环路滤波器依次电连接，所述的锁相环为超宽带集成分频器和压控振荡器的锁相环芯片ADF4360－7，单片机通过电平转换器与集成锁相环芯片ADF4360－7相连接，锁相环芯片的参考时钟和外部电感为常量。
微波雷达系统可变时钟

[发明专利]实现相位锁定功能的电路-CN201310365600.3无效
发明人：胡钢;邱昆 -专利权人：成都成电光信科技有限责任公司
申请日： 2013-08-21 - 公布日： 2013-12-04 - 主分类号： H03L7/08 文献下载
摘要：本发明公开了实现相位锁定功能的电路，包括中央处理器、锁相环芯片、电平位移电路、第一参考时钟芯片、第二参考时钟芯片和现场可编程门阵列FPGA，所述的锁相环芯片、第二参考时钟芯片和现场可编程门阵列FPGA均与中央处理器连接；所述的第一参考时钟芯片连接电平位移电路；所述的电平位移电路还连接锁相环芯片。本发明通过上述原理，采用锁相环芯片对时钟信号进行锁相放大，保证时钟信号的稳定性。
实现相位锁定功能电路

[实用新型]一种基于时序优化的单锁相环快速切换频率合成器-CN202022098408.0有效
发明人：马春利;蒲文飞;屈强;宁涛;邓永辉 -专利权人：陕西烽火电子股份有限公司
申请日： 2020-09-22 - 公布日： 2021-08-17 - 主分类号： H03L7/18 文献下载
摘要：本实用新型提供一种基于时序优化的单锁相环快速切换频率合成器。所述基于时序优化的单锁相环快速切换频率合成器包括硬件电路模块，所述硬件电路模块包括晶体振荡器、锁相环芯片、环路滤波器、VCO、功分器和低噪声放大器，所述晶体振荡器、所述锁相环芯片、所述环路滤波器、所述VCO、所述功分器和所述低噪声放大器依次连接，所述功分器与所述锁相环芯片相连接；时序控制模块，所述时序控制模块与所述锁相环芯片相连接。本实用新型提供的基于时序优化的单锁相环快速切换频率合成器，解决现有的快速切换频率合成器技术存在的线路复杂，体积较大的问题，同时满足频段宽、相位噪声低、经济等要求。
一种基于时序优化单锁相环快速切换频率合成器

[实用新型]基于FPGA芯片的三相数字锁相环、SVPWM调制器及电网谐波电流控制系统-CN201921230888.2有效
发明人：肖冰;史昌明;秘立鹏;邱桂中;吴冠宇;孙睿;章小卫;张新雷 -专利权人：国网内蒙古东部电力有限公司电力科学研究院;北方工业大学;国家电网有限公司
申请日： 2019-07-31 - 公布日： 2020-07-07 - 主分类号： H03L7/20 文献下载
摘要：本公开提出了一种基于FPGA芯片的三相数字锁相环、SVPWM调制器及电网谐波电流控制系统,三相数字锁相环包括设置在于FPGA芯片上的依次连接的Clark变换模块、Park变换模块、PI控制器模块和积分器模块；在FPGA芯片上设置的每个模块为通过将FPGA芯片上的加法器、减法器、乘法器或寄存器连接形成的组合电路；实现了基于FPGA芯片的数字锁相环功能实现的全部控制。本公开的三相数字锁相环通过FPGA芯片实现，可以与其它控制系统兼容，实现了基于FPGA芯片的数字锁相环功能实现的全部控制，降低了硬件布置成本，降低数字锁相环应用系统的硬件复杂度，提高了控制成本。
基于 fpga 芯片三相数字锁相环 svpwm 调制器电网谐波电流控制系统

[实用新型]具有相位锁定功能的时钟电路-CN201320510744.9有效
发明人：胡钢;邱昆 -专利权人：成都成电光信科技有限责任公司
申请日： 2013-08-21 - 公布日： 2014-01-15 - 主分类号： H03L7/08 文献下载
摘要：本实用新型公开了具有相位锁定功能的时钟电路，包括中央处理器、锁相环芯片、电平位移电路、第一参考时钟芯片、第二参考时钟芯片和现场可编程门阵列FPGA，所述的锁相环芯片、第二参考时钟芯片和现场可编程门阵列FPGA均与中央处理器连接；所述的第一参考时钟芯片连接电平位移电路；所述的电平位移电路还连接锁相环芯片。本实用新型通过上述原理，采用锁相环芯片对时钟信号进行锁相放大，保证时钟信号的稳定性。
具有相位锁定功能时钟电路

[发明专利]一种频率合成器模块及其杂散过滤方法-CN201710019755.X在审
发明人：秦安岭 -专利权人：扬州通信设备有限公司
申请日： 2017-01-11 - 公布日： 2017-05-31 - 主分类号： H03L7/18 文献下载
摘要：本发明公开了电子元器件领域内的一种频率合成器模块，包括晶体振荡器，产生一个固定频率信号；第一锁相环芯片，其工作于整数N分频模式，且内置VCO，将晶体振荡器发出的固定参考频率作为参考频率，并输出可调的频率信号；第二锁相环芯片，其工作于整数N分频模式和小数N分频模式，且内置VCO，将第一锁相环芯片输出的可调的频率信号作为参考源，并输出所需的频率信号，通过微调第一锁相环芯片输出的作为参考源的频率信号，以消除该所需频率信号中的边界杂散；所述晶体振荡器的输出端与第一锁相环芯片的输入端相连，第一锁相环芯片的输出端与第二锁相环芯片的输入端相连，其成本低、尺寸小、适用范围广，可用于模块化应用中。
一种频率合成器模块及其过滤方法

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